В HTML      В PDF
микроэлектроника, микросхема, транзистор, диод, микроконтроллер, память, msp430, Atmel, Maxim, LCD, hd44780, t6963, sed1335, avr, mega128
Предприятия Компоненты Документация Применения Статьи Новости

 
Пересюхтюмя


13-я Международная выставка электронных компонентов и комплектующих для электронной промышленности





Выставка Передовые Технологии Автоматизации





Главная страница > Обзоры по типам > Микроконтроллеры > AVR > Архитектура
Пересюхтюмя


13-я Международная выставка электронных компонентов и комплектующих для электронной промышленности





Выставка Передовые Технологии Автоматизации


Время обращения к памяти и тактирование выполнения команд

В данном разделе описаны основные принципы тактирования обращений при выполнении команд и обращений к встроенной памяти.

AVR CPU тактируется системным тактовым сигналом System Clock O, формируемым посредством внешнего кварцевого кристалла. Внутреннее деление не используется.

На Рис.20 представлен процесс параллельных выборки и выполнения команд, обеспечиваемые Гарвардской архитектурой, и концепция регистрового файла быстрого доступа. Это базовый принцип конвейерной обработки, обеспечивающий удельную производительность 1 MIPS/МГц при соответствующих результатах стоимости функции, количества функций на один такт и количества функций на единицу потребляемой мощности.

Параллельные выборка и выполнение команд

Рис. 20. Параллельные выборка и выполнение команд

На Рис. 21 представлен принцип внутреннего тактирования регистрового файла. В течение одного тактового цикла выполнения операции ALU использует два операнда регистров и результат возвращает в регистр назначения.

Одноцикловая работа ALU

Рис. 21. Одноцикловая работа ALU

На Рис. 22 показано обращение к встроенной SRAM данных за два тактовых цикла.

Циклы обращения к внешней SRAM данных без состояния ожидания (Wait State)

Рис. 22. Циклы обращения к внешней SRAM данных без состояния ожидания (Wait State)

На Рис. 23 показано обращение к внешней SRAM данных при установленном бите состояния ожидания (Wait State active).

Циклы обращения к внешней SRAM данных с состоянием ожидания

Рис. 23. Циклы обращения к внешней SRAM данных с состоянием ожидания



<-- Предыдущая страница Оглавление Следующая страница -->

Ноутбуки и компьютеры