Поиск по сайту: |
|
По базе: |
|
Главная страница > Обзоры по типам > Микроконтроллеры > AVR > Архитектура ATMega128 |
|
||||||||||||
Временные диаграммы таймера-счетчика 0На рисунке 41 представлена временная диаграмма работы таймер-счетчика 0 без предделения, при этом, тактовый сигнал таймера (clkT0) показан как сигнал разрешения синхронизации. Счетная последовательность показана в области максимального значения счетчика (0xFF). На рисунках 42-44 показаны аналогичные временные диаграммы, но с разрешенным предделением тактового сигнала. На рисунках также иллюстрируются моменты установки флагов прерываний, в т.ч. флаг OCF0 для всех режимов, кроме CTC, (рисунок 43) и для режима СТС (рисунок 44). На рисунке 44 также показан момент сброса таймера-счетчика TCNT0. Представленные диаграммы соответствуют синхронному по отношению к системной частоте режиму тактирования таймера-счетчика. Однако, они будут полностью соответствовать асинхронному режиму работы, если заменить clkI/O на сигнал генератора таймера-счетчика.
Главная - Микросхемы - DOC - ЖКИ - Источники питания - Электромеханика - Интерфейсы - Программы - Применения - Статьи |
|
Впервые? | Реклама на сайте | О проекте | Карта портала тел. редакции: +7 (995) 900 6254. e-mail:info@eust.ru ©1998-2023 Рынок Микроэлектроники |
|